HF IC Stellenangebote

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8 Jobs für HF IC

Stellenangebote HF IC Jobs

Job am 08.04.2026 bei Jooble gefunden Akkodis

Hardware Layout Engineer (m/w/d)

• Regierungsbezirk Düsseldorf; Westfalen Duisburg, DE Abgeschlossenes Studium Betriebliche Altersvorsorge Physical Layout von Rf/Analog Schaltungsblöcken (Si Ge Bi CMOS) mit Cadence Virtuoso XL Umsetzung von Block-Level-Layouts bis zum vollständigen DRC-/ LVS-signoff Floorplanning in Abstimmung mit RF IC Design und RF-Systemteams [...]

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[...] Durchführung und Begleitung des Tape-out-Prozesses Aufgaben Akkodis ist ein globales Beratungsunternehmen für Digital Engineering, das Technologie und Talente zusammenbringt, um Transformation zu beschleunigen, Innovation voranzutreiben und eine intelligentere Zukunft zu gestalten. Mit mehr als 50.000 Expert:innen in über 30 Ländern verbinden wir Branchen [. .. ] Automatisierung und Cybersecurity. Profil Mehrjährige Erfahrung im RF-/ Analog-Layout, idealerweise mit Si Ge-Bi CMOS Sehr gute Kenntnisse in Layout-Techniken wie Device Matching, Reduktion parasitärer Effekte, RF-Abschirmung und HF-Routing Sicherer Umgang mit dem Design-Flow von Schematic bis GDSII inkl. DRC/ LVS und PDKs Abgeschlossenes Studium der Elektrotechnik oder vergleichbar Benefits Spannende Projekte Internationale und renommierte Kunden Entwicklungsmöglichkeiten in unseren internationalen technischen Büros Tarifliche Vergütung Unbefristetes Anstellungsverhältnis Betriebliche Altersvorsorge Exklusive Mitarbeiterrabatte Attraktives Mitarbeiterempfehlungsprogramm Vielseitige Weiterbildungsmöglichkeiten (Akkodis Academy) Teamevents [. .. ]

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Job am 08.04.2026 bei Jooble gefunden ANECO Institut für Umweltschutz GmbH Co.

Chemielaborant (m/w/d) Umweltanalytik Luft Mönchengladbach Vollzeit

• Regierungsbezirk Düsseldorf; Westfalen Mönchengladbach, DE Flexible Arbeitszeiten 30+ Urlaubstage [. .. ] ein spezialisiertes Fachgebiet einzuarbeiten, bist Du bei uns richtig. Deine Aufgaben Vorbereitung, Aufschluss und Analytik von Luft-, Staub- und Materialproben aus Emissionsmessungen Nasschemische Analysen (Photometrie, Volumetrie, Gravimetrie) [...]

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[...] sowie Ionenchromatographie (IC) für Anionen- und Kationenbestimmung Elementanalytik mittels ICP-OES, ICP-MS und AAS (Schwermetalle wie Pb, Cd, As, Hg) sowie Gasanalyse (HCl, HF, NH3, NO2, SO2) und Kohlenstoffanalytik (TOC/ TC) Dokumentation von Prüfergebnissen gemäß DIN EN ISO/ IEC 17025 und technische Plausibilität Pflege, Kalibrierung und Wartung von Analysegeräten sowie Durchführung von Qualitätssicherungsmaßnahmen (Blindwerte, Referenzstandards, Ringversuche) Einhaltung von Arbeitssicherheitsvorschriften und internen Laborstandards (Gef Stoff V, TRGS) Bringst Du diese Talente mit? Abgeschlossene Berufsausbildung als Chemielaborant/ [. .. ]

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Job am 08.04.2026 bei Jooble gefunden Valentum Engineering GmbH

Mixed Signal ASIC Layout Engineer

• Regierungsbezirk Düsseldorf; Westfalen Duisburg, DE 30+ Urlaubstage Übertarifliche Vergütung [. .. ] Virtuoso XL in enger Zusammenarbeit mit dem Design-Engineering-Team. Block-Level-Layout durch vollständigen Verifizierungsablauf (DRC, LVS) mit Cadence Assura/ PVS DRC-Tools. Floorplanning in Zusammenarbeit mit dem RF-IC-Design- und RF-Systemteam. [...]

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[...] Skripting (z. B. in Skill, Python) . Tape-Out-Verfahren Ihr Profil Mehrjährige Erfahrung im Bereich kundenspezifisches RF-/ Analog-Layout mit umfassenden Kenntnissen der Si Ge-BICMOS-Prozesse. Detaillierte Kenntnisse der Layout-Techniken für Geräteanpassung, Parasitenreduzierung, HF-Abschirmung und optimales Hochfrequenz-Routing. Fundierte Kenntnisse des gesamten Design-Ablaufs vom Schaltplan bis zum GDSII, einschließlich Verifizierung (DRC, LVS) und Prozess-Design-Kits Verhandlungssichere Deutsch- und gute Englischkenntnisse. Unser Angebot Herausforderung. Spannende Projekte mit der Technologie von morgen und von Anfang an verantwortungsvolle Aufgaben. Offenheit. Flache Hierarchien, offene Türen [. .. ]

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Job am 01.04.2026 bei Jobleads gefunden

ASIC Layout Engineer (m/w/d) Rf/Analog

• Duisburg, Nordrhein- Westfalen Abgeschlossenes Studium Weihnachtsgeld [. .. ] Schaltungsmodulen (Cadence Virtuoso XL) Unterstützung des Design-Engineering-Teams Blocklayout bis hin zur vollständigen Verifikations-Flow (DRC, LVS) mit Cadence Assura/ PVS DRC-Tools Floorplanning in Zusammenarbeit mit dem RF-IC-Design- und [...]

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[...] dem RF-System-Team Skripting von Aufgaben (z. B. Skill, Python) Mitarbeit bzgl. der Tape-out-Prozedur Ihr Profil: Abgeschlossenes Studium im Bereich Elektrotechnik, Physik, Luft- und Raumfahrttechnik oder vergleichbare Qualifikation Mehrjährige Erfahrung im Rf/Analog-Layout mit umfangreichen Kenntnissen der Si Ge-Bi CMOS-Prozesse Fachkenntnisse zu Layout-Techniken für Device Matching, Parasitik-Reduktion, RF-Abschirmung und optimale HF-Verkabelung Umfangreiches Verständnis des kompletten Design-Flows von Schaltplan bis GDSII, einschließlich Verifikation (DRC, LVS) und Prozess-Design-Kits Gute Deutsch- und gute Englischkenntnisse erwünscht, in Wort und Schrift Ihr Partner: Die Orizon Gmb H ist Ihr kompetenter Partner, wenn es darum geht, am Arbeitsmarkt Profil zu zeigen. Unsere individuelle Beratung [. .. ]

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Job am 16.12.2025 bei Jobleads gefunden

Rf/Analog Layout Engineer (m/w/x)

• München, Bayern Abgeschlossenes Studium Flexible Arbeitszeiten 30+ Urlaubstage [. .. ] XL in enger Zusammenarbeit mit dem Design Engineering Team Block-Level-Layout durch vollständigen Verifikationsfluss (DRC, LVS) mit Cadence Assura/ PVS DRC-Tools Floor-Planning in Zusammenarbeit mit dem RF IC [...]

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[...] Design und dem RF System Team Skripting von Aufgaben (z. B. Skill, Python) Tape-Out-Verfahren Qualifikationen: Mehrjährige Erfahrung im kundenspezifischen HF-/ Analog-Layout mit umfassenden Kenntnissen über Si Ge-Bi CMOS-Prozesse Detaillierte Kenntnisse von Layouttechniken für die Anpassung von Bauelementen, die Reduzierung von Parasiten, HF-Abschirmung und optimales Hochfrequenz Routing Tiefes Verständnis des gesamten Design Flows vom Schaltplan bis zum GDSII, einschließlich Verifikation (DRC, LVS) und Prozess Design Kits Gute Kommunikationsfähigkeiten [. .. ]

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Job am 02.12.2025 bei Jobleads gefunden

Engineer für Mixed-Signal-ASIC-Layout (m/w/d)

• München, Bayern Abgeschlossenes Studium [. .. ] Bi CMOS-Technologie, unter Nutzung von Cadence Virtuoso XL Durchführung des kompletten Verifikationsprozesses (z. B. DRC, LVS) mithilfe von Cadence Assura/ PVS Mitwirkung an Floorplans in enger Abstimmung [...]

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[...] mit dem RF-IC-Design sowie dem RF-Systemteam Automatisierung und Unterstützung von Entwicklungsabläufen durch eigene Skripte, z. B. in Skill oder Python Vorbereitung und Begleitung des Tape-Out-Prozesses Dein Profil Mehrjährige Erfahrung im kundenspezifischen RF- und Analog-Layout sowie fundierte Kenntnisse in Si Ge-Bi CMOS-Technologien Sicheres Beherrschen relevanter Layout-Methoden, etwa zur Bauteilabstimmung, Reduktion parasitärer Effekte, HF-Abschirmung und optimaler Hochfrequenz Verdrahtung Tiefes Verständnis aller Schritte des Entwicklungsablaufs vom Schaltplan über die Verifikation (DRC/ LVS) bis hin zum finalen GDSII Export inklusive Nutzung von PDKs Gute kommunikative Fähigkeiten sowie ein abgeschlossenes Studium der Elektrotechnik oder einer vergleichbaren Fachrichtung #J-18808-Ljbffr 71173976 [. .. ]

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Job am 30.11.2025 bei Jobleads gefunden Engineer für Mixed-Signal-ASIC-Layout (m/w/d) • München, Bayern Beratungs-/ Consultingtätigkeiten Homeoffice möglich Abgeschlossenes Studium Betriebliche Altersvorsorge 30+ Urlaubstage Work-Life-Balance [. .. ] Bi CMOS-Technologie, unter Nutzung von Cadence Virtuoso XL Durchführung des kompletten Verifikationsprozesses (z. B. DRC, LVS) mithilfe von Cadence Assura/ PVS Mitwirkung an Floorplans in enger Abstimmung [...]

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[...] mit dem RF-IC-Design sowie dem RF-Systemteam Automatisierung und Unterstützung von Entwicklungsabläufen durch eigene Skripte, z. B. in Skill oder Python Vorbereitung und Begleitung des Tape-Out-Prozesses DEIN PROFIL: Mehrjährige Erfahrung im kundenspezifischen RF- und Analog-Layout sowie fundierte Kenntnisse in Si Ge-Bi CMOS-Technologien Sicheres Beherrschen relevanter Layout-Methoden, etwa zur Bauteilabstimmung, Reduktion parasitärer Effekte, HF-Abschirmung und optimaler Hochfrequenz-Verdrahtung Tiefes Verständnis aller Schritte des Entwicklungsablaufs vom Schaltplan über die Verifikation (DRC/ LVS) bis hin zum finalen GDSII-Export inklusive Nutzung von PDKs Gute kommunikative Fähigkeiten sowie ein abgeschlossenes Studium der Elektrotechnik oder einer vergleichbaren Fachrichtung ACONEXT BIETET DIR: Fair Pay+ : Unbefristeter Arbeitsvertrag/ branchenüberdurchschnittliches [. .. ]

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Job am 25.11.2025 bei Jobleads gefunden Mixed Signal ASIC Layout Engineer • München, Bayern 30+ Urlaubstage Übertarifliche Vergütung [. .. ] Virtuoso XL in enger Zusammenarbeit mit dem Design-Engineering-Team. Block-Level-Layout durch vollständigen Verifizierungsablauf (DRC, LVS) mit Cadence Assura/ PVS DRC-Tools. Floorplanning in Zusammenarbeit mit dem RF-IC-Design- und [...]

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[...] RF-Systemteam. Skripting (z. B. in Skill, Python) . Tape Out Verfahren. Qualifikationen Mehrjährige Erfahrung im Bereich kundenspezifisches Rf/Analog-Layout mit umfassenden Kenntnissen der Si Ge-BICMOS-Prozesse. Detaillierte Kenntnisse der Layout-Techniken für Geräteanpassung, Parasitenreduzierung, HF Abschirmung und optimales Hochfrequenz Routing. Fundierte Kenntnisse des gesamten Design Ablaufs vom Schaltplan bis zum GDSII, einschließlich Verifizierung (DRC, LVS) und Prozess Design Kits. Verhandlungssichere Deutsch und gute Englischkenntnisse. Benefits Weitere Informationen Herausforderung. Spannende Projekte mit der Technologie von morgen und von Anfang an verantwortungsvolle Aufgaben. Offenheit. Flache Hierarchien, offene [. .. ]

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Häufig gestellte Fragen

Wieviele offene Stellenangebote gibt es für HF IC Jobs bei unserer Jobsuche?

Aktuell gibt es auf JobRobot 8 offene Stellenanzeigen für HF IC Jobs.

In welchen Bundesländern werden die meisten HF IC Jobs angeboten?

Die meisten Stellenanzeigen für HF IC Jobs werden derzeit in Nordrhein-Westfalen (4 Jobs), Bayern (4 Jobs) und Baden-Württemberg (0 Jobs) angeboten.

Dauer: 0.0369 s., Vers. V.2025-d-2008-Ind-141